A.擴大存儲系統(tǒng)的容量
B.提高存儲系統(tǒng)的速度
C.擴大存儲系統(tǒng)的容量和提高存儲系統(tǒng)的速度
D.便于程序的訪存操作
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A.主存地址
B.邏輯地址
C.物理地址
D.有效地址
A.定長編碼
B.哈夫曼編碼
C.擴展編碼
D.需要根據(jù)編碼使用的頻度計算平均碼長后確定
A.縮短指令字長
B.減少程序總位數(shù)
C.增加指令字表示的信息
D.A和B和C
A.訪存速度快
B.節(jié)約主存單元
C.指令字的規(guī)整化
D.指令的優(yōu)化
A.CPU中的通用寄存器
B.主存儲器
C.I/O接口中的寄存器
D.堆棧
最新試題
共需要多少個觸發(fā)器和多少個與門?
有一個16KB4路組相聯(lián)Cache的32位微處理器,假定該Cache的塊為4個32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
至少要分配給該程序多少個主存頁面才能獲得最高的命中率?
僅根據(jù)使用頻度,不考慮其它要求,設計出全Huffman操作碼,計算其平均碼長。
浮點數(shù)系統(tǒng)使用的階碼基值re=2,階值位數(shù)q=2,尾數(shù)基值rm=10,尾數(shù)位數(shù)p′=1,即按照使用的二進制位數(shù)來說,等價于p=4。計算在非負階、正尾數(shù)、規(guī)格化情況下的最小尾數(shù)值、最大尾數(shù)值、最大階值、可表示的最小值和最大值及可表示數(shù)的個數(shù)。
在編號分別為0,1,2,……,9的16個處理器之間,要求按下列配對通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡類型、控制方式,并畫出該互連網(wǎng)絡的拓撲結構和各級的交換開關狀態(tài)圖。
考慮題目全部要求,設計優(yōu)化實用的操作碼形式,并計算其操作碼的平均碼長。
若Cache的4個塊號為C0、C1、C2和C3,列出程序執(zhí)行過程中的Cache塊地址流。
寫出流水線的初始沖突向量。
若在程序執(zhí)行過程中,每從主存裝入一塊到Cache,平均要對這個塊訪問16次,計算在這種情況下的Cache命中率。