由兩個主從型JK觸發(fā)器組成的邏輯電路如圖a）所示，設(shè)Q1、Q2的初始態(tài)是0、0，已知輸入信號A和脈沖信號CP的波形，如圖b）所示，當(dāng)?shù)诙€CP脈沖作用后，Q1、Q2將變?yōu)椋海ǎ?/p>
A.1、1
B.1、0
C.0、1
D.保持0、0不變
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邏輯電路如圖所示，A="1"時，C脈沖來到后，D觸發(fā)器應(yīng)：（）
A.具有計(jì)數(shù)器功能
B.置"0"
C.置"1"
D.無法確定
圖為三個二極管和電阻R組成一個基本邏輯門電路，輸入二極管的高電平和低電平分別是3V和0V，電路的邏輯關(guān)系式是：（）
A.Y=ABC
B.Y=A+B+C
C.Y=AB+C
D.Y=（A+B.C
（2005）圖示電路中，二極管視為理想元件，即正向電壓降為零，反向電阻為無窮大。三極管的β=100。輸入信號UA、UB的高電平是3.5V，（邏輯1），低電平是0.3V（邏輯0），若該電路的輸出電壓U0為電壓平時定為邏輯1，圖7-10-8所示電路應(yīng)為：（）
A.與門
B.與非門
C.或門
D.或非門
（2007）圖示電路具有：（）
A.保持功能
B.置"0"功能
C.置"1"功能
D.計(jì)數(shù)功能
（2008）如圖所示電路中，Q1、Q2的原始狀態(tài)為"11"當(dāng)送入兩個脈沖后的新狀態(tài)為：（）
A."00"
B."01"
C."11"
D."10"
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