A.噪聲容限低
B.電源適用范圍寬
C.功耗極低
D.扇出能力強(qiáng)
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A.微功耗
B.高速度
C.高抗干擾能力
D.電源范圍寬
A.降低飽和深度
B.增加飽和深度
C.采用有源泄放回路
D.采用抗飽和三極管
A.懸空
B.通過(guò)電阻2.7kΩ接電源
C.通過(guò)電阻2.7kΩ接地
D.通過(guò)電阻510Ω接地
A.正或門(mén)
B.正非門(mén)
C.正與門(mén)
D.負(fù)或門(mén)
A.TSL門(mén)
B.OC門(mén)
C.漏極開(kāi)路門(mén)
D.CMOS與非門(mén)
最新試題
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
TTL與非門(mén)閾值電壓UT的典型值是（）
用原碼輸出的譯碼器實(shí)現(xiàn)多輸出邏輯函數(shù)，需要增加若干個(gè)（）。
采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
什么是觸發(fā)器的不定狀態(tài)，如何避免不定狀態(tài)的出現(xiàn)？
簡(jiǎn)述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。
判斷如下VHDL的操作是否正確，如不正確，請(qǐng)改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
若停電數(shù)分鐘后恢復(fù)供電，（）中的信息能夠保持不變。
兩個(gè)與非門(mén)構(gòu)成的基本RS觸發(fā)器，當(dāng)Q=1、Q=0時(shí)，兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)（）。