單項(xiàng)選擇題PLD開(kāi)發(fā)系統(tǒng)不需要（）。
A.計(jì)算機(jī)
B.燒錄器
C.仿真器
D.開(kāi)發(fā)軟件
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1.單項(xiàng)選擇題CUPL語(yǔ)言中$是什么運(yùn)算符（）。
A.與運(yùn)算符
B.或運(yùn)算符
C.異或運(yùn)算符
D.求補(bǔ)運(yùn)算符
2.單項(xiàng)選擇題下列器件的輸出電路可編程的是（）。
A.PAL
B.GAL
C.PROM
D.PLA
3.單項(xiàng)選擇題可重復(fù)編程的可編程器件有（）。
A.PAL
B.GAL
C.PROM
D.PLA
4.單項(xiàng)選擇題可編程（與、或陣列皆可編程）的可編程邏輯器件有（）。
A.PAL
B.GAL
C.PROM
D.PLA
5.單項(xiàng)選擇題PAL的結(jié)構(gòu)是（）。
A.PAL的或陣列可編程
B.PAL的與陣列、或陣列均不可編程
C.PAL與陣列、或陣列均可編程
D.PAL的與陣列可編程
最新試題
小容量RAM內(nèi)部存儲(chǔ)矩陣的字?jǐn)?shù)與外部地址線數(shù)n的關(guān)系一般為（）
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TTL與非門輸出高電平的參數(shù)規(guī)范值是（）
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一個(gè)兩輸入端的門電路，當(dāng)輸入為10時(shí)，輸出不是1的門電路為（）
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采用浮柵技術(shù)的EPROM中存儲(chǔ)的數(shù)據(jù)是（）可擦除的。
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10-4線優(yōu)先編碼器允許同時(shí)輸入（）路編碼信號(hào)。
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基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱為（）觸發(fā)器。
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一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡(jiǎn)述它們的作用。
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什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？
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用1M×4的DRAM芯片通過(guò)（）擴(kuò)展可以獲得4M×8的存儲(chǔ)器。
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利用2個(gè)74LS138和1個(gè)非門，可以擴(kuò)展得到1個(gè)（）線譯碼器。
題型：?jiǎn)雾?xiàng)選擇題