A.結(jié)構(gòu)體對應的實體的端口表中
B.結(jié)構(gòu)體中關(guān)鍵詞BEGIN前
C.結(jié)構(gòu)體中關(guān)鍵詞BEGIN后
D.程序包(PACKAGE)
您可能感興趣的試卷
你可能感興趣的試題
A.結(jié)構(gòu)體(ARCHITECTURE)
B.進程(PROCESS)中的關(guān)鍵詞BEGIN前
C.進程(PROCESS)中的關(guān)鍵詞BEGIN后
D.程序包(PACKAGE)
A.ARCHITECTURE
B.ENTITY
C.PROCESS
D.PACKAGE
A.順序
B.并行
C.即可順序也可并行
D.無法確定
A.行為、元件及連接關(guān)系
B.元件、子程序、公用數(shù)據(jù)類型
C.名稱和端口的引腳等
D.可編譯的設(shè)計單元
A.行為、元件及連接關(guān)系
B.元件、子程序、公用數(shù)據(jù)類型
C.名稱和端口的引腳等
D.可編譯的設(shè)計單元
最新試題
()在計算機系統(tǒng)中得到了廣泛的應用,其中一個重要用途是構(gòu)成數(shù)據(jù)總線。
與倒T形電阻網(wǎng)絡DAC相比,權(quán)電流網(wǎng)絡D/A轉(zhuǎn)換器的主要優(yōu)點是消除了()對轉(zhuǎn)換精度的影響。
利用2個74LS138和1個非門,可以擴展得到1個()線譯碼器。
用1M×4的DRAM芯片通過()擴展可以獲得4M×8的存儲器。
小容量RAM內(nèi)部存儲矩陣的字數(shù)與外部地址線數(shù)n的關(guān)系一般為()
一個兩輸入端的門電路,當輸入為10時,輸出不是1的門電路為()
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài),所以它不能被稱為()觸發(fā)器。
判斷如下VHDL的操作是否正確,如不正確,請改正。字符a和b的數(shù)據(jù)類型是BIT,c是INTEGER,執(zhí)行c<=a+b。
以下哪個編碼不能是二-十進制譯碼器的輸入編碼()
試提出數(shù)字頻率計的三種設(shè)計方案,比較各種方案的特點。如果用HDPLD來實現(xiàn),設(shè)計方案是最佳嗎?簡述理由。